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在本文中，我們將介紹如何構建帶有VGA輸出的低分辨率熱成像。該解決方案基于Melexis MLX90640紅外陣列、FPGA S7 50開發板(AMD-Xilinx Spartan-7 FPGA，帶VGA輸出)。

TJ375已經支持PLL的動態配置。打開PLL在Advance Settings中的Dynamic Reconfiguration中勾選Enable就可以了。最大可以支持85組配置參數。動態配置框圖如下： （1）在interface中打開動態配置功能 使用PLL動態配置功能需要打開PLL的reset和lock信號， 需要兩個時鐘，pll_cfg_clk_i 和 pll_cfg_clk， pll_cfg_clk_i是一個輸入時鐘，pll_cfg_clk是動態配置的輸出時鐘， 通過另一個PLL產生一個pll_CFG_CLK_i 在生成動態配置IP之前要先配置PLL的hex step1:把PLL配置成50M （2）添加配置參數。點擊 Reco

“? Icepi Zero 是一款 Raspberry Pi Zero 尺寸的便攜式 FPGA 開發板，基于 Lattice ECP5。 ” ? Made with KiCad 系列將支持新的展示方式。直接將以下鏈接復制到瀏覽器中(或點擊“閱讀原文”)： https://www.eda.cn/ecadViewer/viewerPage?xmlId=02070198-e0ce-4a9c-9d3b-bf71cef6644d PCB License Solderpad Hardware License v2.1 倉庫 & 下載 可以在Github中獲取開源倉庫： https://github.com/cheyao/icepi-zero Baidu 下載： ?

對于嵌入式系統工程師而言，選擇合適的 DRAM 至關重要，需綜合考慮帶寬、時延與功耗限制。在近期發布的白皮書中，我們詳細比較了主要的內存類型（包括 DDR4、DDR5、LPDDR4 和 LPDDR5），并針對視頻處理和 AI 推理等高吞吐量應用提供了實用的選擇建議。

自適應濾波是近幾十年發展起來的信號處理理論的的新分支。隨著人們在該領域研究的不斷深入，自適應處理的理論和技術日趨完善，其應用領域也越來越廣泛。自適應濾波在通信、控制、語言分析和綜合、地震信號處理、雷達和聲吶波束形成，以及醫學診斷等諸多科學領域均有著廣泛的應用，也正是這些應用又反過來推動了自適應濾波理論和技術的發展。

隨著人工智能的發展，神經網絡正被逐步應用于智能安防、自動駕駛、醫療等各行各業。目標識別作為人工智能的一項重要應用也擁有著巨大的前景，隨著深度學習的普及和框架的成熟，卷積神經網絡模型的識別精度越來越高。有名的LeNet-5手寫數字識別網絡，精度達到99%，AlexNet模型和VGG-16模型的提出突破了傳統圖像識別算法，GooLeNet和ResNet推動了卷積神經網絡的應用。

本設計中，計劃實現對文件的壓縮及解壓，同時優化壓縮中所涉及的信號處理和計算密集型功能，實現對其的加速處理。本設計的最終目標是證明在充分并行化的硬件體系結構 FPGA 上實現該算法時，可以大大提高該算法的速度。我們將首先使用C語言進行代碼實現，然后在Vivado HLS中綜合實現，并最終在FPGA板（pynq-z2）上進行硬件實現，同時于jupyter notebook中使用python來進行功能驗證。

2025年7月1日至3日，歐洲FPGA大會在德國慕尼黑盛大舉行。作為FPGA領域的年度盛會，此次大會吸引了來自全球各地的企業、專家與學者，共同探討FPGA技術的前沿趨勢與應用創新。我們有幸參與其中，收獲頗豐。歐洲FPGA大會概況歐洲FPGA大會已成為歐洲地區可編程邏輯器件領域的權威專業會議。今年的大會在慕尼黑的NH慕尼黑東站會議中心酒店舉行，為期三天的議程涵

該項目是在友晶DE1-SOC開發板實現Chirikov標準映射的求解器，并將其應用于圖像加密和解密的概念驗證。

借助Verilog，在FPGA中實現了帶編碼器的兩臺電機的電機控制系統的RTL級設計。

本文講述了AMD UltraScale /UltraScale+ FPGA 原生模式下，異步模式與同步模式的對比及其對時鐘設置的影響。

? PIO IP是FPGA 設計中比較簡單常用的IP， 當設置PIO IP的Direction的時候，可以看到有如下4個選項： Input代表這組IO是輸入引腳，Output代表這組IO是輸出引腳，這些很好理解，但Bidir和InOut都表示雙向的意思，它們有什么區別嗎？ 參考28.4.1.2. Direction (intel.com)可知： bidir，指n位寬的信號中的每一位都可以單獨/分別設置為讀或是寫。 inout，指將n位寬的信號，全設置為讀或全部設置為寫，但是不能要求其中某些位讀而某些位為寫。 只有設置為bidir模式的時候，才存

在國產 FPGA 加速突破、邁向高性能、高可靠的新階段，智多晶隆重推出新一代 SA5T-200 系列 FPGA 器件。該系列面向高算力、高清視頻、高速通信等關鍵應用場景，集成豐富硬核資源、兼容主流方案、性能大幅提升，為系統設計提供更具競爭力的國產替代解決方案。這不僅是一款新產品，更是智多晶在國產高端 FPGA 市場的戰略級布局。

近日，“2025智多晶FPGA技術研討會”在武漢成功舉辦。本次交流會以“智繪新篇 晶質領航”為主題，智多晶專業技術團隊在會上揭曉了公司匠心打造的多款FPGA芯片新產品、多項新應用方案。

數據爆炸式增長正推動新產品需求激增，這些新產品需具備數據傳輸、處理和存儲能力，并方便開發人員從中獲得可執行的深度分析，助力他們基于硬件靈活性來應對市場需求的動態變化、集成多種功能，并適配不斷演進的行業標準，更好地應對多樣化工作負載帶來的挑戰。

在現代電子科技飛速發展的浪潮中，FPGA（Field Programmable Gate Array，現場可編程門陣列）猶如一顆璀璨的明星，在通信、人工智能、汽車電子等眾多領域閃耀著獨特的光芒。這個看似神秘的技術名詞，究竟是什么？又為何能在電子領域掀起一場又一場變革？讓我們一同揭開 FPGA 的神秘面紗。

電子系統設計師在為當今的汽車、工業和消費應用設計產品時面臨著一系列挑戰。他們必須確保產品在不同設備上的精確度、緊湊集成和能源效率，同時滿足不斷增長的性能期望。與此同時，對于必須確保產品質量穩定、長期可用性和技術創新的制造商來說，維持有彈性且安全的供應鏈比以往任何時候都更加重要。

Veloce proFPGA 平臺提供三類主板：Uno、Duo 和 Quad。這些主板支持輕松插入和混用不同類型的現場可編程門陣列 (FPGA) 模塊以及外圍存儲器和協議接口板。作為使用案例的一個例子，工程師可以從 proFPGA Uno 系統開始進行 IP 或子片上系統 (SoC) 的開發，然后將其重復用于完整的 SoC 和專用集成電路 (ASIC)原型設計。這只需要將 Uno 中的相同 Veloce proFPGA 模塊插到 Duo 或 Quad 主板上，而無需考慮新系統上使用的 FPGA 類型。

近日，被譽為 “全球移動通信行業發展風向標” 的 2025世界移動通信大會（MWC上海）在上海新國際博覽中心圓滿落幕。本屆大會以 “開啟智能互聯新紀元” 為主題，吸引全球創新企業及政策制定者齊聚。紫光同創是唯一一家亮相本次大會的國產FPGA廠商，攜手多家合作伙伴及終端客戶，向全球科技先鋒們多層次地展示公司在通信領域創新實力和前沿探索。

傳感器輸出經過標定的數字信號輸出，通過標準的I2C接口傳輸數據。